Intel annuncia il nuovo lago xeon cascade con un massimo di 48 core
Sommario:
Intel ha annunciato la prossima famiglia di processori Xeon Cascade Lake che prevede di lanciare nella prima metà del prossimo anno. Le nuove parti rappresentano un miglioramento sostanziale, con un massimo di 48 core e 12 canali di memoria DDR4 per socket, supportando fino a due socket.
Intel Xeon Cascade Lake avrà un design non monolitico
Questi processori Cascade Lake offrono prestazioni di livello superiore rispetto ai processori scalabili (SP) di Xeon. I chip Xeon SP odierni utilizzano un dado monolitico, con un massimo di 28 core e 56 thread. Invece Cascade Lake AP sarà un processore multi-chip con matrici multiple in un unico pacchetto. AMD utilizza un approccio simile per i suoi prodotti comparabili, con i processori EPYC che utilizzano quattro stampi in ciascun pacchetto.
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Il passaggio a un design multi-chip è probabile perché, man mano che le matrici diventano sempre più grandi, hanno maggiori probabilità di contenere un difetto. L'uso di matrici più piccole aiuta a prevenire questi difetti. Poiché il processo di produzione a 10 nm di Intel non è ancora abbastanza buono per la produzione di massa, i nuovi Xeon continueranno a utilizzare una versione del processo a 14 nm dell'azienda. L'enorme quantità di canali di memoria richiederà un enorme socket, attualmente considerato un connettore a 5903 pin.
In particolare, Intel sta elencando solo un numero di core per questi processori, piuttosto che la solita combinazione di core e thread count. Non è chiaro se ciò significhi che i nuovi processori non avranno HT o se la società preferisce enfatizzare i core fisici ed evitare alcuni dei problemi di sicurezza che HT può presentare in determinati scenari di utilizzo.
Complessivamente, la società afferma che il 20% di miglioramento delle prestazioni rispetto agli attuali Xeon SP e il 240% rispetto all'EPYC di AMD, con maggiori guadagni nei carichi di lavoro che richiedono un utilizzo intenso della larghezza di banda. la memoria. I nuovi processori includeranno una serie di nuove istruzioni AVX512 progettate per migliorare le prestazioni delle reti neurali funzionanti.
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